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wyszukanych pozycji: 16
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Real Time Applications of Computer Network II
ISBN: 9783659688751 / Angielski / Miękka / 2020 / 56 str. Termin realizacji zamówienia: ok. 10-14 dni roboczych. |
cena:
182,66 zł |
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Performance Evaluation of 3D SRAM Architecture using Coaxial TSV
ISBN: 9783659746499 / Angielski / Miękka / 2015 / 68 str. Termin realizacji zamówienia: ok. 10-14 dni roboczych. 3D stacking of logic and memory devices is essential to keep the Moore's law ticking. In 3D integration, memory devices can be stacked on the top of processors. TSV based 3D memory architecture enables the reuse of logic dies with multiple memory layers. Conventional 3D memory suffer from speed, power and yield overhead due to large parasitic load of TSV and cross layer PVT variations. In order to overcome these limitations, this paper the physical design of a semi master-slave (SMS) architecture of 3D SRAM which provides a constant-load logic-SRAM interface across various stacked layers and...
3D stacking of logic and memory devices is essential to keep the Moore's law ticking. In 3D integration, memory devices can be stacked on the top of p...
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cena:
164,35 zł |
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MPSoC con architettura multi-core eterogenea single-ISA
ISBN: 9786204516325 / Włoski / Miękka / 64 str. Termin realizacji zamówienia: ok. 10-14 dni roboczych. |
cena:
164,35 zł |
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MPSoCs with single-ISA heterogeneous multi-core architecture : Research Perspective
ISBN: 9786139474158 / Angielski Termin realizacji zamówienia: ok. 10-14 dni roboczych. |
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164,35 zł |
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MPSoCs mit heterogener Single-ISA-Multi-Core-Architektur
ISBN: 9786204516295 / Miękka / 68 str. Termin realizacji zamówienia: ok. 10-14 dni roboczych. Die RST-Prozessorzuweisungsmethode für MPSoCs mit heterogener Single-ISA-Multicore-Architektur, die als vielversprechende Plattform für die Entwicklung von MPSoCs gilt. Das Ziel der vorgeschlagenen Methode ist es, eine geeignete Prozessorzuweisung und Task-Mapping-Konfiguration zu finden, so dass die Ausführungszeit der Ziel-Workloads optimiert wird, während die gegebene Ressourcen-/Flächenbeschränkung erfüllt wird. Da der Lösungsraum des Zielsyntheseproblems exponentiell mit der Anzahl der Tasks in der Ziel-Workload und der Anzahl der Cores wächst, haben wir eine heuristisch...
Die RST-Prozessorzuweisungsmethode für MPSoCs mit heterogener Single-ISA-Multicore-Architektur, die als vielversprechende Plattform für die Entwickl...
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164,35 zł |
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MPSoCs avec architecture multi-coeurs hétérogène single-ISA
ISBN: 9786204516318 / Francuski / Miękka / 64 str. Termin realizacji zamówienia: ok. 10-14 dni roboczych. La méthode d'allocation de processeur RST pour les MPSoCs avec architecture multicoeur hétérogène single-ISA, qui est considérée comme une plateforme prometteuse pour le développement des MPSoCs. L'objectif de la méthode proposée est d'aboutir à une allocation de processeur appropriée et à une configuration de mappage de tâches telle que le temps d'exécution de la charge de travail cible soit optimisé tout en respectant les contraintes de ressources et d'espace données. Étant donné que l'espace de solution du problème de synthèse cible croît de manière exponentielle avec...
La méthode d'allocation de processeur RST pour les MPSoCs avec architecture multicoeur hétérogène single-ISA, qui est considérée comme une plate...
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164,35 zł |
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MPSoCs com arquitectura multi-núcleo heterogénea de um só visto
ISBN: 9786204516332 / Portugalski / Miękka / 64 str. Termin realizacji zamówienia: ok. 10-14 dni roboczych. |
cena:
164,35 zł |
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MPSoC s geterogennoj mnogoqdernoj arhitekturoj single-ISA
ISBN: 9786204516349 / Rosyjski / Miękka / 68 str. Termin realizacji zamówienia: ok. 10-14 dni roboczych. |
cena:
90,65 zł |
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Acceleratore hardware condiviso per un'architettura AHt-MPSoC ibrida
ISBN: 9786204664835 / Włoski / Miękka / 64 str. Termin realizacji zamówienia: ok. 10-14 dni roboczych. |
cena:
182,66 zł |
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Obschij apparatnyj uskoritel' dlq gibridnoj arhitektury AHt-MPSoC
ISBN: 9786204664866 / Rosyjski / Miękka / 68 str. Termin realizacji zamówienia: ok. 10-14 dni roboczych. |
cena:
90,65 zł |
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Accélérateur matériel partagé pour l'architecture hybride AHt-MPSoC
ISBN: 9786204664828 / Francuski / Miękka / 68 str. Termin realizacji zamówienia: ok. 10-14 dni roboczych. Dans ce système, une nouvelle classe d'architecture hybride AHt-MPSoC est présentée, dans laquelle les accélérateurs matériels sont partagés entre les processeurs de manière à réduire le coût du système et à augmenter les performances. Un nouveau schéma de mémoire hybride est proposé par ce schéma est évalué par une simulation extensive pour montrer des améliorations significatives de la performance. L'architecture MPSoC hybride asymétrique se compose d'une mémoire vive statique (SRAM) et d'une cellule de mémoire vive dynamique intégrée (eDRAM) en association avec la...
Dans ce système, une nouvelle classe d'architecture hybride AHt-MPSoC est présentée, dans laquelle les accélérateurs matériels sont partagés en...
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cena:
182,66 zł |
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Shared Hardware Accelerator for Hybrid AHt-MPSoC Architecture : Research Perspective
ISBN: 9786139463121 / Angielski Termin realizacji zamówienia: ok. 10-14 dni roboczych. |
cena:
182,66 zł |
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Acelerador de Hardware Partilhado para Arquitectura Híbrida AHt-MPSoC
ISBN: 9786204664859 / Portugalski / Miękka / 64 str. Termin realizacji zamówienia: ok. 10-14 dni roboczych. |
cena:
182,66 zł |
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Gemeinsamer Hardware-Beschleuniger für hybride AHt-MPSoC-Architektur
ISBN: 9786204664804 / Miękka / 68 str. Termin realizacji zamówienia: ok. 10-14 dni roboczych. In diesem System wird eine neue Klasse von hybriden AHt-MPSoC-Architekturen vorgestellt, in denen Hardware-Beschleuniger zwischen Prozessoren geteilt werden, um die Systemkosten zu senken und die Leistung zu erhöhen. Ein neuartiges hybrides Speicherschema wird vorgeschlagen. Dieses Schema wird durch umfangreiche Simulationen bewertet und zeigt signifikante Leistungsverbesserungen. Die hybride asymmetrische heterogene MPSoC-Architektur besteht aus einem statischen Speicher mit wahlfreiem Zugriff (SRAM) und einer eingebetteten Zelle mit dynamischem Speicher mit wahlfreiem Zugriff (eDRAM) in...
In diesem System wird eine neue Klasse von hybriden AHt-MPSoC-Architekturen vorgestellt, in denen Hardware-Beschleuniger zwischen Prozessoren geteilt ...
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cena:
182,66 zł |
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Performance and Analysis of Task Out-of-Order Execution in MPSoCs
ISBN: 9783659827594 / Angielski / Miękka / 2016 / 76 str. Termin realizacji zamówienia: ok. 10-14 dni roboczych. The inter-subsystem communication structure can be optimized at the beginning of the design process by using simulation models at three different abstraction levels. Some design loop cases can be avoided by using this exploration method. With the Motion-JPEG case study, and illustrate the whole communication exploration process step by step. From experimental results, it show that compared with the cycle accurate simulation, the inter subsystem communication can be well optimized and evaluated at higher abstraction levels. In this project, a solution for a classification problem that is used...
The inter-subsystem communication structure can be optimized at the beginning of the design process by using simulation models at three different abst...
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cena:
164,35 zł |
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Real Time Application of Computer Networks
ISBN: 9786139459834 / Angielski / Miękka / 2019 / 52 str. Termin realizacji zamówienia: ok. 10-14 dni roboczych. |
cena:
182,66 zł |
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