Synthèse VHDL d'architectures

ISBN-13: 9783841627766 / Francuski / Miękka / 200 str.

Ridha Ghayoula; Jaouhar Fattahi

Opis

Ce livre de langage VHDL s'adresse particulièrement aux étudiants en Licences professionnelles et recherches, en Masters et aux élèves ingénieurs. L'utilisation d'un langage VHDL évolué (Hardware Description langage, comme VHDL ou Verilog ) dans la modélisation et la conception des circuits intégrés numériques est aujourd'hui indispensable. Cet édition de ce livre présente le tout nouveau standard VHDL-2008, disponible aujourd'hui sur la plupart des outils de simulation et de synthèse. Des compléments, programmes complets et exercices corrigés. Pour découvrir l'ensemble des possibilités offertes par le langage VHDL, le lecteur est invité à suivre des exemples qui l'amènent à réaliser des applications faciles à implanter dans un circuit programmable. Les testes et les pièges à éviter sont également présentés dans cette démarche d'élaboration d'un nouveau composant numérique.

O autorze

Ridha Ghayoula a reçu le diplôme d'Ingénieur, Docteur de l'université Tunis El Manar, Tunisie et un certificat post doctoral en Télécommunication et systèmes embarqués de l'université Laval, Canada. Ses intérêts actuels comprennent le génie logiciel, la sécurité informatique, les FPGA, les processeurs softcore, les systèmes embarqués et temps réel.